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更新时间: 2025-08-22 13:47:01
1人问答
问题描述:

Error(10327):VHDLerroratxd.vhd(17):can'tdeterminedefinitionofoperator""+""--found0pos

初学VHDL~

LIBRARYIEEE;

USEIEEE.STD_LOGIC_1164.ALL;

ENTITYxdIS

PORT(sel:INstd_logic;

d0,d1:INstd_logic;

led:OUTstd_logic);

ENDENTITYxd;

ARCHITECTUREabcOFxdIS

signalnum0:std_logic_VECTOR(7DOWNTO0);

signalnum:std_logic_VECTOR(7DOWNTO0);

BEGIN

num0

李树广回答:
  第二行添加   USEIEEE.STD_LOGIC_UNSIGNED.ALL;
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